課.程.目.標(biāo) |
| 本課程通過(guò)大量的實(shí)際電路設(shè)計(jì)，使得學(xué)員可以在較短時(shí)間內(nèi)具備電路板設(shè)計(jì)的全面能力。 |
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培.養(yǎng).對(duì).象 |
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對(duì)電路原理知識(shí)有一定了解，有過(guò)單片機(jī)或相關(guān)電路設(shè)計(jì)經(jīng)驗(yàn)的工程師，企業(yè)硬件設(shè)計(jì)部門負(fù)責(zé)人。 |
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班.級(jí).規(guī).模.及.環(huán).境 |
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為了保證培訓(xùn)效果，增加互動(dòng)環(huán)節(jié)，我們堅(jiān)持小班授課，每期報(bào)名人數(shù)限5人，多余人員安排到下一期進(jìn)行。 |
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.質(zhì).量.保.障. |
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1、培訓(xùn)過(guò)程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
2、培訓(xùn)結(jié)束后,培訓(xùn)老師留給學(xué)員手機(jī)和Email,免費(fèi)提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。 ☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)。專注高端培訓(xùn)13年，曙海提供的證書得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。 |
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教學(xué)時(shí)間，教學(xué)地點(diǎn) |
上課地點(diǎn)：【上海】：同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號(hào)線白銀路站) 【深圳分部】：深圳大學(xué)成教院/ 電影大廈(地鐵一號(hào)線大劇院站)【北京分部】：福鑫大樓/北京中山學(xué)院 【武漢分部】：佳源大廈（高新二路） 【南京分部】：金港大廈(和燕路)
【成都分部】：領(lǐng)館區(qū)1號(hào)（中和大道）
最近開課時(shí)間(連續(xù)班/周末班/晚班）：PCB Layout班開課：2025年12月15日..以質(zhì)量贏得尊重節(jié)假日班火熱報(bào)名中.....實(shí)戰(zhàn)培訓(xùn)......直播、現(xiàn)場(chǎng)培訓(xùn)皆可....用心服務(wù)..............--即將開課-----即將開課，請(qǐng)咨詢客服。 |
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學(xué)時(shí) |
課時(shí)： 一個(gè)月
◆外地學(xué)員：代理安排食宿（需提前預(yù)定）
☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)資格證書，提升您的職業(yè)資質(zhì)
作為最早專注于嵌入式培訓(xùn)的專業(yè)機(jī)構(gòu)，曙海嵌入式學(xué)院提供的證書得到本行業(yè)的廣泛認(rèn)
可，學(xué)員的能力得到大家的認(rèn)同。
☆合格學(xué)員免費(fèi)推薦工作
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師資團(tuán)隊(duì) |
◆【李老師】
8年來(lái)一直從事FPGA數(shù)字電路設(shè)計(jì)，高速DSP軟硬件的開發(fā)，高速PCB，Layout設(shè)計(jì)經(jīng)驗(yàn)非常豐富。
精通Allegro cadence和candence SPECCTRAQuest等信號(hào)完整性仿真，精通高速PCB
SI仿真、Altium Designer以及PADS工具 。成功開發(fā)了多個(gè)高速DSP和FPGA結(jié)合的高難度項(xiàng)目。 ◆【黃老師】
有9年的FPGA和DSP系統(tǒng)硬件開發(fā)經(jīng)驗(yàn),5年視頻和圖像處理領(lǐng)域的高速DSP系統(tǒng)硬、軟件和FPGA系統(tǒng)的設(shè)計(jì)和開發(fā)經(jīng)驗(yàn)，高速系統(tǒng)設(shè)計(jì)經(jīng)驗(yàn)非常豐富，精通Allegro
cadence和candence SPECCTRAQuest等信號(hào)完整性仿真，精通高速PCB SI仿真工具以及PADS,Altium Designer等PCB設(shè)計(jì)工具。
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課.程.進(jìn).度.安.排 |
| .課.程.大.綱. |
第一階段-Allegro(Cadence)電子線路板設(shè)計(jì) |
學(xué)習(xí)使用 ORCAD 軟件進(jìn)行原理圖的制作，電路圖的零件設(shè)計(jì)、使用
Allegro 軟件進(jìn)行 PCBLayout ， PCB 封裝制作、高速布線規(guī)則設(shè)置、出 gerber 文件、用
CAM350 檢查 gerber 文件。應(yīng)用范圍：制作高速線路板（如：DSP6000高速板等） .
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第二階段 Allegro Cadence 仿真、信號(hào)完整性 |
1 高速PCB設(shè)計(jì)中的理論基礎(chǔ)
傳輸線理論、信號(hào)完整性（反射、串?dāng)_、過(guò)沖、地彈、振鈴等）、電磁兼容性和時(shí)序匹配等等。
2 SPECCTRAQuest設(shè)計(jì)流程
2.1 Pre-Placement
2.2 Board Setup Requirements
for Extracting and Applying Topologies
2.3 Database Setup Advisor
—Cross-Section
—DC
Nets
—DC
Voltages
—Device
Setup
—SI Models
—SI
Audit
3 拓?fù)浣Y(jié)構(gòu)的抽取與仿真 Extracting and Simulating Topologies
3.1 Pre-Route Extraction Setup—Default
Model Selection.
3.2 Pre-Route Extraction Setup—Unrouted
Interconnect
3.3 Pre-Route Template Extraction
3.4 SQ Signal Explorer Expert
3.5 Analysis Preferences
3.6 SigWave
3.7 Delay Measurements
4
差分信號(hào)設(shè)計(jì) Differential Pair Design Exploration
8.1 Types of Differential Pairs
in SPECCTRAQuest
8.2 Create Differential Pair
Using SPECCTRAQuest
8.3 Create Differential Pair
Using Constraint Manager
8.4 Assigning Differential Pair
Signal Models
8.5 Preference to Extract Unrouted
Differential Pair Topology
8.6 Extracting Unrouted Differential
Pair Topology
8.7 Custom Stimulus to Analyze
Differential Pair Topology
8.8 Differential Pair Topology
Analysis
8.9 Coupled Trace Model and
Differential Pair Topology
8.10 Layout Cross-section Editor
8.11 Differential Pair Constraints
8.12 Differential Pair Constraints
in the Constraint Manager
8.13 Differential Pair Analysis
in the Constraint Manager
8.14 Post Route Extraction
5 時(shí)序仿真和和PI仿真
5.1 時(shí)序仿真
5.2 PI仿真 |
第三階段-Allegro Cadence DSP6000高速板設(shè)計(jì)實(shí)戰(zhàn) |
DSP6000高速板設(shè)計(jì)主要內(nèi)容有:
1.DSP6000高速板功能方框圖培訓(xùn)。
2.元件庫(kù)建立管理
3.電腦原理圖設(shè)計(jì)
4.電腦PCB疊層結(jié)構(gòu)、阻抗控制介紹
5.電腦PCB布局以及布線設(shè)計(jì)
6.出Gerber文件
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